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/ NetNews Usenet Archive 1992 #31 / NN_1992_31.iso / spool / comp / sys / amiga / hardware / 22022 < prev    next >
Encoding:
Internet Message Format  |  1992-12-23  |  2.5 KB
  1. Path: sparky!uunet!munnari.oz.au!ariel.ucs.unimelb.EDU.AU!ucsvc.ucs.unimelb.edu.au!mits.com.au!ratty.mits.com.au!lewis
  2. Newsgroups: comp.sys.amiga.hardware
  3. Subject: Re: Data/Instruction Cache & BURST modes on 68030? Why/when?
  4. Message-ID: <1992Dec24.110249.1@ratty.mits.com.au>
  5. From: lewis@ratty.mits.com.au
  6. Date: 24 Dec 92 11:02:49 +1000
  7. References: <hellerS.724958427@batman> <72192@cup.portal.com> <smcgerty.725067816@unix1.tcd.ie>
  8. Organization: MITS
  9. Nntp-Posting-Host: ratty
  10. Nntp-Posting-User: lewis
  11. Lines: 45
  12.  
  13. In article <smcgerty.725067816@unix1.tcd.ie>, smcgerty@unix1.tcd.ie (Stephen John McGerty) writes:
  14. > In <72192@cup.portal.com> Tony-Preston@cup.portal.com (ANTHONY FRANCIS PRESTON) writes:
  15. >>Data cache is an area of memory(varies in size with different processors,
  16. >>generally, more is better) that the cpu saves data that might be used over
  17. >>again.
  18.  
  19. [ Stuff cut ]
  20.  
  21. > With this in mind, why is it that Motorola have seperate instruction
  22. > and data caches? On the i486 there is a single 8k cache used for
  23. > both instructions and data. On the M68040, there is one 4k cache
  24. > for data, and another 4k cache for instructions. Which is better?
  25. > 
  26. > I hear that the Intel 586 is going to have seperate instruction
  27. > and data caches, as in the M68040, so this would seem to imply that
  28. > this is the prefered arrangement...?
  29. > 
  30. > The only thing I can think of is that you might not want your instruction
  31. > cache getting overwritten with less frequently used data, in a vector
  32. > operation or something. But this isn't really a serious factor, or
  33. > so I'm told...
  34. > 
  35. > Anyone any inspired thoughts?
  36. > 
  37. > : / T | /  Stephen John McGerty (C.Sci)  "Theory must never   Amiga  // :
  38. > : / | |/   smcgerty@unix1.tcd.ie          precede creation"       \\//  :
  39.  
  40. The manufacturers decide on whether to use a unified or split cache
  41. arrangement by getting instruction and data trace data for real programs,
  42. and running this data through simulations of the difference cache
  43. arrangements, sizes, associativity, etc.  This helps them to find which
  44. setup suits the processor design best.
  45.  
  46. I recall from reading an IEEE Micro article on the i486 design that they
  47. found the single 8k cache performed better for their simulations, and in
  48. another article, I seem to remember a similar statement from the Motorola
  49. 68040 designers saying that their simulations showed the split 4k caches to
  50. perform better.
  51.  
  52. -- 
  53. David Lewis,
  54.  
  55. Internet:    lewis@mits.com.au
  56. Phone:        +61 3 613 9415        Fax:        +61 3 613 9550
  57. "No call alligator long mouth till you pass him." - Jamaican Proverb.
  58.