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/ NetNews Usenet Archive 1992 #31 / NN_1992_31.iso / spool / comp / sys / amiga / hardware / 21969 < prev    next >
Encoding:
Text File  |  1992-12-22  |  1.4 KB  |  27 lines
  1. Newsgroups: comp.sys.amiga.hardware
  2. Path: sparky!uunet!hela.iti.org!cs.widener.edu!batman!hellerS
  3. From: hellerS@moravian.edu (sjh)
  4. Subject: Re: Data/Instruction Cache & BURST modes on 68030? Why/when?
  5. Message-ID: <hellerS.725061488@batman>
  6. Nntp-Posting-Host: batman
  7. References: <hellerS.724958427@batman> <72192@cup.portal.com>
  8. Distribution: na
  9. Date: Tue, 22 Dec 92 17:06:41 EST
  10. Lines: 15
  11.  
  12. Thanks to all who wrote me replies on these questions. However, I've gotten
  13. a few different replies, so I called CSA and asked for the "straight
  14. answer" and this is what they said. As far as the MMR goes, there is NO
  15. burst mode capability, regardless of 32-bit memory speed. As far as the
  16. data/instruction caches go, if you HAVE NO 32-bit memory on the CPU, the
  17. caches can speed things up a bit, but are essentially useless when working
  18. with 32-bit DRAM. His suggestion was to LEAVE the CACHES and BURST OFF.
  19. Several people were pretty certain that 60ns was the magic number for DRAM
  20. speed to be able to use burst mode. The CSA guy laughed and said that was
  21. nonsense - it just doesn't exist on the MMR. It was a feature they had
  22. originally intended to include but decided to leave it out because they
  23. felt there was virtually no demand for it...why, I don't know. It must work
  24. on some accellerators, but not the MMR (or the Derringer).
  25.  
  26. So that's the scoop, direct from the tech-support at CSA.
  27.