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Text File  |  1998-09-29  |  4KB  |  94 lines
  1. <WAIT>
  2. [1]
  3. "WAIT: Wait"
  4. ""
  5. "Causes the processor to check for and handle pending, unmasked, floating-point exceptions before proceeding. (FWAIT is an alternate mnemonic for the WAIT). This instruction is useful for synchronizing exceptions in critical sections of code. Coding a WAIT instruction after a floating-point instruction insures that any unmasked floating-point exceptions the instruction may raise are handled before the processor can modify the instructionÆs results."
  6. [2]
  7. "CheckForPendingUnmaskedFloatingPointExceptions;"
  8. [3]
  9. "The C0, C1, C2, and C3 flags are undefined."
  10. [4]
  11. "Floating-Point Exceptions"
  12. ""
  13. "None."
  14. ""
  15. "Protected Mode Exceptions"
  16. ""
  17. "#NM MP and TS in CR0 is set."
  18. ""
  19. "Real-Address Mode Exceptions"
  20. ""
  21. "#NM MP and TS in CR0 is set."
  22. ""
  23. "Virtual-8086 Mode Exceptions"
  24. ""
  25. "#NM MP and TS in CR0 is set."
  26. [5]
  27. "9B WAIT Check pending unmasked floating-point exceptions."
  28. [6]
  29. </WAIT>
  30. <WBINVD>
  31. [1]
  32. "WBINVD: Write Back and Invalidate Cache"
  33. ""
  34. "Writes back all modified cache lines in the processorÆs internal cache to main memory and invalidates (flushes) the internal caches. The instruction then issues a special-function bus cycle that directs external caches to also write back modified data and another bus cycle to indicate that the external caches should be invalidated."
  35. "After executing this instruction, the processor does not wait for the external caches to complete their write-back and flushing operations before proceeding with instruction execution. It is the responsibility of hardware to respond to the cache write-back and flush signals. The WDINVD instruction is a privileged instruction. When the processor is running in protected mode, the CPL of a program or procedure must be 0 to execute this instruction. This instruction is also a serializing instruction."
  36. ""
  37. "Intel Architecture Compatibility"
  38. ""
  39. "The WBINVD instruction is implementation dependent, and its function may be implemented differently on future Intel Architecture processors. The instruction is not supported on Intel Architecture processors earlier than the Intel486 processor."
  40. [2]
  41. "WriteBack(InternalCaches);"
  42. "Flush(InternalCaches);"
  43. "SignalWriteBack(ExternalCaches);"
  44. "SignalFlush(ExternalCaches);"
  45. "Continue (* Continue execution);"
  46. [3]
  47. "None."
  48. [4]
  49. "Protected Mode Exceptions"
  50. ""
  51. "#GP(0) If the current privilege level is not 0."
  52. ""
  53. "Real-Address Mode Exceptions"
  54. ""
  55. "None."
  56. ""
  57. "Virtual-8086 Mode Exceptions"
  58. ""
  59. "#GP(0) The WBINVD instruction cannot be executed at the virtual-8086 mode."
  60. [5]
  61. "0F 09 WBINVD Write back and flush Internal caches; initiate writing-back and flushing of external caches."
  62. [6]
  63. </WBINVD>
  64. <WRMSR>
  65. [1]
  66. "WRMSR: Write to Model Specific Register"
  67. ""
  68. "Writes the contents of registers EDX:EAX into the 64-bit model specific register (MSR) specified in the ECX register. The high-order 32 bits are copied from EDX and the low-order 32 bits are copied from EAX. Always set the undefined or reserved bits in an MSR to the values previously read."
  69. "This instruction must be executed at privilege level 0 or in real-address mode; otherwise, a general protection exception #GP(0) will be generated. Specifying a reserved or unimplemented MSR address in ECX will also cause a general protection exception."
  70. "When the WRMSR instruction is used to write to an MTRR, the TLBs are invalidated, including the global entries. (MTRRs are an implementation-specific feature of the Pentium Pro processor.)"
  71. ""
  72. "Intel Architecture Compatibility"
  73. ""
  74. "The MSRs and the ability to read them with the WRMSR instruction were introduced into the Intel Architecture with the Pentium processor. Execution of this instruction by an Intel Architecture processor earlier than the Pentium processor results in an invalid opcode exception #UD."
  75. [2]
  76. "MSR[ECX] ¼ EDX:EAX;"
  77. [3]
  78. "None."
  79. [4]
  80. "Protected Mode Exceptions"
  81. ""
  82. "#GP(0) If the current privilege level is not 0. If the value in ECX specifies a reserved or unimplemented MSR address."
  83. ""
  84. "Real-Address Mode Exceptions"
  85. ""
  86. "#GP If the value in ECX specifies a reserved or unimplemented MSR address."
  87. ""
  88. "Virtual-8086 Mode Exceptions"
  89. ""
  90. "#GP(0) The WRMSR instruction is not recognized in virtual-8086 mode."
  91. [5]
  92. "0F 30 WRMSR Write the value in EDX:EAX to MSR specified by ECX"
  93. [6]
  94. </WRMSR>