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Text File  |  1995-04-10  |  1.6 KB  |  42 lines
  1. :LIST_OF_FIGURES
  2.  
  3. ~<andtest.pcx>~  : `~AND-Gate Chip for ~INTEST~ Example~`
  4. ~<bednails.pcx>~ : `~"Bed-of-Nails" Board Tester~`
  5. ~<bidirpin.pcx>~ : `~A Bidirectional ~I/O~ Pin~`
  6. ~<bsircell.pcx>~ : `~Boundary Scan Instruction Register Cells~`
  7. ~<extest.pcx>~   : `~Chip and Interconnections for ~EXTEST~ Example~`
  8. ~<jtgadder.pcx>~ : `~Configuration for Testing the 8-Bit Adder~`
  9. ~<scancirc.pcx>~ : `~Boundary Scan Circuitry for a Single ~I/O~ Pin~`
  10. ~<scanpath.pcx>~ : `~Adding a Boundary Scan Register to a Logic Circuit~`
  11. ~<scncirin.pcx>~ : `~Complete Boundary Scan Cell for an Input Pin~`
  12. ~<scncirou.pcx>~ : `~Complete Boundary Scan Cell for an Output Pin~`
  13. ~<scnclin1.pcx>~ : `~Minimal Boundary Scan Cell for an Input Pin~`
  14. ~<scnclou1.pcx>~ : `~Minimal Boundary Scan Cell for an Output Pin~`
  15. ~<subrorg.pcx>~  : `~JTAG Subroutine Library Organization~`
  16. ~<tapcnnct.pcx>~ : `~The ~TAP~ Controller and Its Interconnection~`
  17. ~<tapcntrl.pcx>~ : `~The Complete ~TAP~ Controller~`
  18. ~<tapstate.pcx>~ : `~TAP Controller State Diagram~`
  19.  
  20.  
  21. :LIST_OF_PLDasm_FILES
  22.  
  23. ~<add.pds>~ : `~Adder/shift-register design~`
  24. ~<add.rpt>~ : `~Adder report file~`
  25.  
  26.  
  27. :LIST_OF_C_FILES
  28.  
  29. ~<addtest.c>~ : `~Adder test program~`
  30. ~<example.c>~ : `~EXTEST example program~`
  31. ~<jtag.c>~    : `~JTAG subroutine library~`
  32. ~<jtag.h>~    : `~JTAG subroutine library header~`
  33.  
  34. **************************************
  35. * Copyright 1995 by XESS Corporation *
  36. *        2608 Sweetgum Drive         *
  37. *          Apex, NC 27502            *
  38. *               USA                  *
  39. *          (919) 387-0076            *
  40. *          (800) 549-9377            *
  41. **************************************
  42.